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问:怎样审查工程信号在芯片结构位置?????

答:在HqFpga软件GUI界面中,,,点击“工具”选择“结构图”即可审查整个芯片的PLL、Serdes、Slice、DDRC等资源所在位置信息。。。�;;;;;诖丝梢栽谖锢碓际显际拇嫫魑恢�,,,多路Serdes使用时也可以凭证应用场景划分约束Serdes位置信息等。。。。

问:怎样提高FPGA的加载速率?????

答:在HqFpga软件GUI界面中,,,点击“设置”,,,选择“位流天生”,,,“DCLK频率”可供选择,,,最高支持到66.84M,,,频率越高加载速率越快。。。。

问:HqFpga怎样导入第三方代码编辑器?????

答:在HqFpga软件GUI界面中,,,点击“设置”,,,选择“工具”,,,点击“...”选项,,,按目录索引到自己常用的代码编辑软件添加即可,,,这样双击设计文件就会跳转至设置的代码编辑软件,,,利便用户修改代码。。。。

问:HqFPGA是否支持批量导入引脚约束?????

答:支持。。。。

问:HqFpga怎样同时用多个触发条件收罗数据?????

答:HqFpga已经支持了用多个条件同时触发的操作,,,只需要在波形收罗界面右上角点击+号就可以添加新的收罗条件了。。。。


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联系电话 :? 029-89589302

手艺支持:support@isilicontech.com

市场营销:marketing@isilicontech.com

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